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Test Circuits and Waveforms
V DS
L
I AS
t P
BV DSS
V DS
VARY t P TO OBTAIN
REQUIRED PEAK I AS
V GS
R G
DUT
+
-
V DD
V DD
0V
t P
I AS
0
0.01 ?
t AV
Figure 12. Unclamped Energy Test Circuit
Figure 13. Unclamped Energy Waveforms
V GS
V DS
R L
+
-
V DD
V DD
V GS
Q g(TOT)
V DS
V GS = 10V
DUT
V GS = 1V
I g(REF)
0
I g(REF)
0
Q g(TH)
Q gs
Q gd
Figure 14. Gate Charge Test Circuit
Figure 15. Gate Charge Waveforms
V DS
R L
V DS
t ON
t d(ON)
90%
t r
t OFF
t d(OFF)
t f
90%
V GS
+
-
V DD
0
10%
10%
R GS
DUT
90%
V GS
50%
50%
V GS
Figure 16. Switching Time Test Circuit
0
10%
PULSE WIDTH
Figure 17. Switching Time Waveform
?2003 Fairchild Semiconductor Corporation
FDB15N50 Rev. C1
5
www.fairchildsemi.com
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